Arquitectura de Computadores II Quiz

Froggy Jumps

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Desafío de Arquitectura de Computadores II

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ESTELA MORALES MARTINEZ

Bolivia

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Arquitectura de Computadores II Quiz


Froggy Jumps Arquitectura de Computadores II QuizVersion en ligne Desafío de Arquitectura de Computadores II par ESTELA MORALES MARTINEZ 1 ¿Qué objetivo tiene la predicción de saltos en una CPU? a Reducir las pérdidas por saltos en la tubería. b Duplicar la cantidad de núcleos. c Aumentar la frecuencia del reloj. 2 ¿En arquitecturas superscalar, qué se busca lograr? a Reducir la latencia de la memoria. b Ejecutar varias instrucciones por ciclo. c Aumentar la temperatura de la CPU. 3 ¿Qué describe la coherencia de caché en multiprocesadores? a Duplicar el tamaño de la caché. b Mantener datos consistentes entre cachés de varios núcleos. c Eliminar la jerarquía de memoria. 4 ¿Qué es la memoria virtual y cuál es su propósito? a Traducir direcciones lógicas a físicas y aislar procesos. b Almacenar solo datos del sistema operativo. c Aumentar la velocidad de la RAM. 5 ¿Qué función cumple un TLB en la gestión de memoria? a Aumenta la capacidad de memoria física. b Almacena código de usuario sin paginación. c Cachea traducciones de direcciones virtuales a físicas. 6 ¿Qué es un pipeline en microarquitectura? a Dividir la ejecución en etapas para procesar varias instrucciones en paralelo. b Aumentar el tamaño de la caché. c Ejecutar una instrucción por ciclo. 7 ¿Qué implica la ejecución fuera de orden (OoO)? a Solo se ejecutan en orden. b Ejecutar instrucciones cuando estén disponibles, fuera de orden. c Elimina dependencias entre instrucciones. 8 ¿Qué es SIMD? a Ejecutar varias instrucciones distintas en paralelo. b Aumentar la velocidad del reloj. c Ejecutar la misma instrucción en varios datos. 9 ¿Qué diferencia principal existe entre caches L1, L2 y L3? a L3 es la más rápida. b L1 rápido y pequeño; L3 grande y más lento. c L1 es la más lenta. 10 ¿Qué estructura almacena direcciones de saltos para predicción rápida? a Buffer de objetivo de rama (BTB). b TLB (tabla de traducción de direcciones). c Cache L1 de datos.

Vous pouvez intégrer le jeu dans un LMS compatible avec LTI 1.1 ou LTI 1.3 comme Canvas, Moodle ou Blackboard. Les scores seront ainsi automatiquement enregistrés dans le carnet de notes de la plateforme.

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par ESTELA MORALES MARTINEZ

¿Qué objetivo tiene la predicción de saltos en una CPU?

¿En arquitecturas superscalar, qué se busca lograr?

¿Qué describe la coherencia de caché en multiprocesadores?

¿Qué es la memoria virtual y cuál es su propósito?

¿Qué función cumple un TLB en la gestión de memoria?

¿Qué es un pipeline en microarquitectura?

¿Qué implica la ejecución fuera de orden (OoO)?

¿Qué es SIMD?

¿Qué diferencia principal existe entre caches L1, L2 y L3?

¿Qué estructura almacena direcciones de saltos para predicción rápida?